試題詳解

試卷：114年 - 11700 數位電子甲級工作項目 05：電子學與電子電路 101-145（2025/12/12 更新）#134860 | 科目：技檢◆數位電子-甲級

試卷名稱：114年 - 11700 數位電子甲級工作項目 05：電子學與電子電路 101-145（2025/12/12 更新）#134860

年份：114年

科目：技檢◆數位電子-甲級

127. 空乏型 FET，若其夾止電壓 V_P=-5V，則當加在閘極至源極的電壓V_GS=0V 且 1V＜V_DS＜5V 時，此 FET 會工作在什麼區域？
(A)崩潰區
(B)飽和區
(C)三極管區
(D)截止區。

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