14. 微處理機在執行指令時，經常以管線 ( Pipeline ) 技術來加速執行效率，通常相同的指令數 可用較少時序完成。若在執行精簡指令集 RISC 之指令時，可分為四個相同執行時間 之步驟：指令提取、指令解碼、運算元提取、指令執行，並分別交派給四個不同處理 單元負責。若以管線技術執行指令時，在不考慮跳躍或資料相依狀況下，需執行多少 指令數可使有管線執行方式比無管線執行方式快 3 倍？
(A) 9
(B) 8
(C) 7
(D) 6

1. 微處理機指令之執行，一般可概分為三個階段：指令提取階段、指令解碼階段及指令 執行階段，關於微處理機指令執行之敘述，下列何者錯誤？ (A) 於指令提取階段中，微處理機依據程式計數器 ( Program Counter, PC ) 中之指令位址， 至記憶體讀取指令。讀取完畢後，PC 會自動遞增，指向下一個指令位址 (B) 於指令解碼階段中，微處理機將指令分解成運算碼 ( Operation Code, OP Code ) 及運算元 ( Operand ) ，其中運算碼代表指令執行之功能，而運算元則是代表指令執行運算之對象 (C) 於指令執行階段中，通常必須先提取所需之運算元，才能進行欲執行之指令功能 (D) 有些指令可不須經過指令解碼階段，即可直接執行

2. 在微處理機電路設計中，若要用來驅動較大負載，例如馬達轉速控制，可使用下列何種 方式模擬類比訊號？ (A) TWI ( Two - Wire Bus Interface ) (B) UART ( Universal Asynchronous Receiver Transmitter ) (C) JTAG ( Joint Test Action Group ) (D) PWM ( Pulse Width Modulation )

3. 隨身碟及固態硬碟 ( Solid - State Disk, SSD ) 的使用越來越普及，且容量不斷增加，它們 分別是使用下列何種記憶體來儲存資料？ (A) 隨身碟使用 Flash Memory，固態硬碟使用 SRAM ( Static RAM ) (B) 隨身碟使用 SRAM，固態硬碟使用 Flash Memory (C) 兩者都是使用 Flash Memory (D) 兩者都是使用 SRAM 

4. 完整微處理機系統中包含硬體與軟體，其中軟體部份大多包含作業系統 ( Operating System, OS ) ，關於作業系統之敘述，下列何者錯誤？ (A) 作業系統提供使用者程式與微處理機系統硬體間之介面 (B) 作業系統通常不包括基本輸出入 ( Input / Output, I / O ) 驅動程式 ( Drivers ) (C) 作業系統大都提供使用者圖形介面 ( Graphical User Interface, GUI ) 服務 (D) 作業系統可有效率的管理微處理機系統之硬體及軟體資源 

5. 假設有一微處理機的組合語言指令集 ( Instruction Set ) 如表 ( 一 ) 所示，若有一組合語言程式如圖 ( 一 ) ，其中 D 與 E 的初始值各為 3 與 5，程式中所缺的「組合語言指令 X」應是 下列哪一個選項，才能讓程式執行結束後，F 的值等於 4？ 圖(一)(A) INC E (B) DEC D (C) ADD F, G (D) SUB D, G

6. USB 1.1 / 2.0 介面訊號是使用下列何種編碼方式？ (A) RZI ( Return to Zero, Inverted ) 編碼 (B) NRZI ( Non Return to Zero, Inverted ) 編碼 (C) NRZ ( Non Return to Zero ) 編碼 (D) RZ ( Return to Zero ) 編碼

7. SPI 與 I 2 C ( 或稱為 IIC ) 兩種匯流排之比較，下列何者錯誤？ (A) 兩種匯流排皆為串列匯流排 (B) 兩種匯流排皆為同步匯流排 (C) 兩種匯流排皆能建置一主多從架構 (D) 兩種匯流排皆為半雙工傳輸

8. 若有一個 SPI 匯流排要建置星狀連接一對三主從架構，則 SPI 主裝置需要多少接腳數目 才可滿足此一對三的匯流排架構？ (A) 3 (B) 4 (C) 5 (D) 6

9. 微處理機之中斷種類主要分為硬體中斷與軟體中斷二類，關於硬體中斷或軟體中斷之敘述，下列何者錯誤？ (A) 硬體中斷可分為可遮罩中斷 ( Maskable Interrupt, MI ) 及不可遮罩中斷 ( Non - Maskable Interrupt, NMI ) 二類 (B) NMI 可透過中斷遮罩暫存器 ( Interrupt Mask Register, IMR ) 來設定遮罩位元，以接受 或拒絕 NMI (C) 軟體中斷是由程式透過作業系統服務執行中斷指令 (D) 週邊裝置可透過微處理機的 INTR ( Interrupt Request ) 接腳來送出硬體中斷

10. 如圖 ( 二 ) 所示，8259 A 是 Intel 開發設計之可程式中斷控制器 ( Programmable Interrupt Controller, PIC ) ，關於 8259 A 之敘述，下列何者錯誤？(A) ( Slave Program / Enable Buffer ) 作為輸入接腳時，可用來選擇 8259 A 之主 或僕之角色， = 0 表示此 8259 A 為主控制器(B) 共有 8 個中斷請求輸入接腳 IR0 ~ IR7，可供週邊裝置發送中斷請求(C) 共有 8 個資料傳輸接腳 D0 ~ D7，通常與微處理機之資料匯流排連接，可供 8259 A 與 微處理機間傳送資料(D) 共有 3 個串接 ( Cascade ) 接腳 CAS 0 ~ CAS 2，用來串接多顆 8259 A，最多可串接 8 顆， 最多可處理 64 個中斷請求

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