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五、圖五為 CMOS 邏輯電路，其中 Qn 特性均相同，Qp1 之(W/L)值為 Qp2 的 三倍，已知位移率（mobility）μn = 2 μp，請求出：
⑵當 Qp全導通時（即 A = B = C = D = 0），電路由輸出端流出至負載之 拉升（pull up）電流為 IPU；當 Qn 全導通時（即 A = B = C = D = 1）， 由負載流入電路之拉降（pull down）電流為 IPD。設計使 IPU = IPD，令 (W/L)n = x(W/L)p2，x =？（10 分）
