24. 如圖(十二)為利用一個 7483( 4 位元全加器)及四個互斥或閘，實現一個四位元加減法器 之電路，若此加減法器欲執行『減法』，則 M 及 C0的輸入須為何？5cb58a8b489ef.jpg
(A) M=0，C0=0
(B) M=0，C0=1
(C) M=1，C0=0
(D) M=1，C0=1 

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統計： A(0), B(0), C(3), D(5), E(0) #1980239